photo

Arun


Tenesix Inc.

Last seen: casi 3 años hace |  Con actividad desde 2014

Followers: 0   Following: 0

Mensaje

Estadística

  • Thankful Level 1

Ver insignias

Feeds

Ver por

Pregunta


HDL Coder RAM generation for an array
will hdl coder generate ram for 2 dimension array if isempty(my_ary) my_ary = zeros (10,1000) end new_value = [1:10...

más de 9 años hace | 1 respuesta | 0

1

respuesta

Pregunta


Matlab to RTL - Block RAM Enable
An array will get recognized as block RAM. So foo_ary(index) = write_value_at_index will write to the block RAM Question - how...

más de 9 años hace | 2 respuestas | 0

2

respuestas

Pregunta


No of Pipeline Stages in Verilog coming from an m file (or latency)
How does one find how many pipeline stages exist in the verilog file. Example, run the mdhlc_sobel filter example from the web s...

casi 10 años hace | 2 respuestas | 0

2

respuestas

Pregunta


HDL Resource Untilization does not match Synthsis Ouput
When running hdl coder for example on mlhdlc_sobelfilter.m the utilization report says the hdl needs multipliers (90) adders/Sub...

casi 10 años hace | 1 respuesta | 0

1

respuesta