HDL Implementation and Verification of a High-Performance FFT
Learn how to implement and verify a high-speed signal processing algorithm using HDL Coder and HDL Verifier.
High-speed signal processing is a requirement for application such as radar, broadband wireless and backhaul. This webinar illustrates the workflow for designing a 1.6 giga-samples per second (GSPS) fast Fourier transform (FFT) algorithm and implementing it on an FPGA.
The demonstration will include:
- Developing a high-level radix-4 4096-point FFT algorithm in MATLAB.
- Building the hardware implementation model in Simulink.
- Converting the implementation to fixed-point.
- Optimizing for the target FPGA device.
- Generating synthesizable VHDL using HDL Coder that achieves 1.6 GSPS with only 60 multipliers.
- Verifying the generated VHDL using HDL Verifier.
Recorded: 23 Jun 2015
Featured Product
HDL Coder
Seleccione un país/idioma
Seleccione un país/idioma para obtener contenido traducido, si está disponible, y ver eventos y ofertas de productos y servicios locales. Según su ubicación geográfica, recomendamos que seleccione: .
También puede seleccionar uno de estos países/idiomas:
Cómo obtener el mejor rendimiento
Seleccione China (en idioma chino o inglés) para obtener el mejor rendimiento. Los sitios web de otros países no están optimizados para ser accedidos desde su ubicación geográfica.
América
- América Latina (Español)
- Canada (English)
- United States (English)
Europa
- Belgium (English)
- Denmark (English)
- Deutschland (Deutsch)
- España (Español)
- Finland (English)
- France (Français)
- Ireland (English)
- Italia (Italiano)
- Luxembourg (English)
- Netherlands (English)
- Norway (English)
- Österreich (Deutsch)
- Portugal (English)
- Sweden (English)
- Switzerland
- United Kingdom (English)
Asia-Pacífico
- Australia (English)
- India (English)
- New Zealand (English)
- 中国
- 日本Japanese (日本語)
- 한국Korean (한국어)